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- W655450587 abstract "L'augmentation de la complexite des systemes embarques impose aux concepteurs de ces systemes l'utilisation des modeles avec un niveau d'abstraction plus haut que le niveau RTL (Regiter Transfer Level) pour modeliser, valider et analyser les performances de ces systemes. Ceci permet de reduire le temps de la re-conception et donc reduire le temps de mise sur marche. Dans cette these, nous proposons une methodologie utile pour la construction d'un environnement de simulation au niveau TLM (Transaction Level Modeling) integre a notre outil STARSoC (Synthesis Tool for Adaptative and Reconfigurable System-On-Chip). Le but de ce travail est de fournir un outil pour faire de l'exploration d'architecture a haut niveau d'abstraction d'une maniere plus precise et plus rapide pour les architectures multiprocesseur sur puce (MPSoC). Notre plateforme de conception de reference contient plusieurs simulateurs de jeux d'instructions (Instruction Set Simulator's) du processeur OpenRISC 1200 wrappe sous SystemC, ainsi que d'autres peripheriques de base (modele de bus base sur le protocole Wishbone, des modeles de memoire, etc. ). Afin de fournir un environnement unique de developpement, nous avons utilise le langage SystemC pour la modelisation et la simulation de notre plateforme, a plusieurs niveaux d'abstraction. Cette plateforme est manipulee sous a partir de l'IDE Eclipse." @default.
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