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- W846699173 abstract "Les recentes evolutions en microelectronique necessitent une attention particuliere lors de la conception d’un circuit. Depuis les noeuds technologiques de quelques dizaines de nanometres, les contraintes de consommation deviennent preponderantes. Pour repondre a ce probleme, les concepteurs se penchent aujourd’hui sur l’utilisation d’architectures multi-coeurs heterogenes incluant des accelerateurs materiels dotes d’une grande efficacite energetique. Le maintien des specifications d’un circuit apparait egalement essentiel a l’heure ou sa fabrication est de plus en plus sujette a la variabilite et aux defauts. Il existe donc un reel besoin pour des accelerateurs robustes. Les architectures neuromorphiques, et notamment les reseaux de neurones a impulsions, offrent une bonne tolerance aux defauts, de part leur parallelisme massif, et une aptitude a executer diverses applications a faible cout energetique. La these defendue se presente sous deux aspects. Le premier consiste en la conception d’un neurone analogique robuste et a son integration dans un accelerateur materiel neuro-inspire a des fins calculatoires. Cet operateur mathematique a basse consommation a ete dimensionne puis dessine en technologie 65 nm. Integre au sein de deux circuits, il a pu etre caracterise dans l’un d’entre eux et ainsi demontrer la faisabilite d’operations mathematiques elementaires. Le second objectif est d’estimer, a plus long terme, l’impact des nouvelles technologies sur le developpement de ce type d’architecture. Ainsi, les axes de recherches suivis ont permis d’etudier un passage vers un noeud technologique tres avance, les opportunites procurees par des Through-Silicon-Vias ou encore, l’utilisation de memoires resistives a changement de phase ou a filament conducteur." @default.
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